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关于AIC3204的BCLK和WCLK输出疑问求解

199 音频编解码器 mcu

问答对人有帮助，内容完整，我也想知道答案 0 我在使用AIC3204时遇到很奇怪的问题(AIC23B正常）。我希望配置3204为主模式，输出BCLK和WCLK, 使用了别的MCU, 控制程序用了usbstk5505的例程中的aic3204_loop_linein（）和aic3204_tone_headphone( )，反复检查硬件，与usbstk5505完全一致。MCU操作I2C写3204成功，可看到正确应答信号。（如将地址改为别的，就没有应答，故判断MCU与3204应通信正常），MCLK用有源晶振10M, 但是我怎么也无法在BCLK和WCLK看到输出,已经调试1周无法解决，万望各位不吝赐教！程序如下，请帮忙看看是否有错误。以下主要是配置AIC3204，没有I2S数据收发部分。我理解只要配置完就应该在BCLK和WCLK测到输出波形，是这样吧？ Int16 aic3204_tone_headphone( ) { Int16 j, i = 0; Int16 sample; I2C_Init(AIC3204_IDENT_W); /* Configure Serial Bus / //SYS_EXBUSSEL \|= 0x0100; // Configure Serial bus 0 for I2S0 / Configure AIC3204 / if(!AIC3204_rset( 0, 0 ))return false; // Select page 0 AIC3204_rset( 1, 1 ); // Reset codec AIC3204_rset( 0, 1 ); // Select page 1 AIC3204_rset( 1, 8 ); // Disable crude AVDD generation from DVDD AIC3204_rset( 2, 1 ); // Enable Analog Blocks, use LDO power AIC3204_rset( 0, 0 ); / PLL and Clocks config and Power Up / AIC3204_rset( 27, 0x0c ); // ori=d BCLK and WCLK are set as o/p; AIC3204(Master) AIC3204_rset( 28, 0x00 ); // Data ofset = 0 AIC3204_rset( 4, 3 ); // PLL setting: PLLCLK <- MCLK, CODEC_CLKIN <-PLL CLK AIC3204_rset( 6, 5 ); // PLL setting: J=5;ORI=J=7 //AIC3204_rset( 7, 0x0 ); // PLL setting: HI_BYTE(D=0) //AIC3204_rset( 8, 0x0 ); // PLL setting: LO_BYTE(D=0), //AIC3204_rset( 7, 0x06 ); // PLL setting: HI_BYTE(D=1680) //AIC3204_rset( 8, 0x90 ); // PLL setting: LO_BYTE(D=1680), AIC3204_rset( 29, 0x80 ); AIC3204_rset( 30, 0x84 ); // For 32 bit clocks per frame in Master mode ONLY // BCLK=DAC_CLK/N =(12288000/8) = 1.536MHz = 32fs AIC3204_rset( 5, 0xA1 ); // PLL setting:0XA1=P=2 and R=1; ORI=0X91=Power up PLL, P=1 and R=1 AIC3204_rset( 13, 0 ); // Hi_Byte(DOSR) for DOSR = 128 decimal or 0x0080 DAC oversamppling AIC3204_rset( 14, 0x80 ); // Lo_Byte(DOSR) for DOSR = 128 decimal or 0x0080 AIC3204_rset( 20, 0x80 ); // AOSR for AOSR = 128 decimal or 0x0080 for decimation filters 1 to 6 AIC3204_rset( 11, 0x83 ); // Power up NDAC and set NDAC value to 3,ORI=2 AIC3204_rset( 12, 0x85 ); // Power up MDAC and set MDAC value to 5,ORI=7 AIC3204_rset( 18, 0x85 ); // Power up NADC and set NADC value to 5,ORI=7 AIC3204_rset( 19, 0x83 ); // Power up MADC and set MADC value to 3,ORI=2 /* DAC ROUTING and Power Up / AIC3204_rset( 0, 1 ); // Select page 1 AIC3204_rset( 0x0c, 8 ); // LDAC AFIR routed to HPL AIC3204_rset( 0x0d, 8 ); // RDAC AFIR routed to HPR AIC3204_rset( 0, 0 ); // Select page 0 AIC3204_rset( 64, 2 ); // Left vol=right vol AIC3204_rset( 65, 0); // Left DAC gain to 0dB VOL; Right tracks Left AIC3204_rset( 63, 0xd4 ); // Power up left,right data paths and set channel AIC3204_rset( 0, 1 ); // Select page 1 AIC3204_rset( 0x10, 0x00 );// Unmute HPL , 0dB gain AIC3204_rset( 0x11, 0x00 );// Unmute HPR , 0dB gain AIC3204_rset( 9, 0x30 ); // Power up HPL,HPR AIC3204_rset( 0, 0 ); // Select page 0 //USBSTK5505_wait( 100 ); // wait Delayms(100); / ADC ROUTING and Power Up */ AIC3204_rset( 0, 1 ); // Select page 1 AIC3204_rset( 0x34, 0x30 );// STEREO 1 Jack // IN2_L to LADC_P through 40 kohm AIC3204_rset( 0x37, 0x30 );// IN2_R to RADC_P through 40 kohmm AIC3204_rset( 0x36, 3 ); // CM_1 (common mode) to LADC_M through 40 kohm AIC3204_rset( 0x39, 0xc0 );// CM_1 (common mode) to RADC_M through 40 kohm AIC3204_rset( 0x3b, 0 ); // MIC_PGA_L unmute AIC3204_rset( 0x3c, 0 ); // MIC_PGA_R unmute AIC3204_rset( 0, 0 ); // Select page 0 AIC3204_rset( 0x51, 0xc0 );// Powerup Left and Right ADC AIC3204_rset( 0x52, 0 ); // Unmute Left and Right ADC AIC3204_rset( 0, 0 ); //USBSTK5505_wait( 200 ); // Wait Delayms(100); } 0 本主题由 Harmony威廉希尔官方网站专家于 2024-11-7 10:51 审核通过
2024-11-7 07:35:05　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 新星之火12138 该类别下有 83 个回答。邀请回答 heks 该类别下有 75 个回答。邀请回答 wang21cj 该类别下有 72 个回答。邀请回答普罗旺斯的薰衣草该类别下有 69 个回答。邀请回答 hgimtk 该类别下有 64 个回答。邀请回答 chm5 该类别下有 62 个回答。邀请回答风动影随该类别下有 55 个回答。邀请回答 lksas 该类别下有 54 个回答。邀请回答 zhhx1985 该类别下有 53 个回答。邀请回答站着幻想该类别下有 52 个回答。邀请回答 hfgsd 该类别下有 51 个回答。邀请回答 blueshine 该类别下有 50 个回答。邀请回答 fdhsfagd 该类别下有 50 个回答。邀请回答你又知道了该类别下有 50 个回答。邀请回答青上也该类别下有 50 个回答。邀请回答 zhouxk 该类别下有 50 个回答。邀请回答 kghfh 该类别下有 50 个回答。邀请回答深海零下一度1 该类别下有 49 个回答。邀请回答 ufydsyfsf 该类别下有 49 个回答。邀请回答 dsdfshf 该类别下有 49 个回答。邀请回答举报吕珠峰相关推荐 • TLV320AIC3204具有什么特点？怎么配置？ 1912 • 如何判断TLV320AIC3204是否正常工作？ 216 • TMS320c5517的AIC3204声音输出程序设置 3587 • 请问TIBQ.exe工具在aic3204中滤波时怎么使用？ 193 • TMS320C5535的aic3204音频测试例子中ioport 3885 • 用ezdsp5535板子实现麦克风输入语音信息，耳机输出语音，为什么编译的时候通不过？ 204 • TLV320AIC3104板卡进行信号测试时，发现DOUT线上有异常电平怎么解决？ 257 • MCU通过IIC口控制TLV320AIC3204，请问MCU的IIC接口和TLV320AIC3204的IIC接口对接时需要电平转换吗？ 390 • 请问AIC3204的IN1L/IN1R到HPL/HPR的连接无法断开吗？ 567 • TLV320AIC3254时钟配置，为什么产生的BCLK不是705.6KHz呢？ 267 3个回答

答案对人有帮助，有参考价值 0 一是配置问题，另外是MCLK硬件连接问题，导致MCLK未送入。

2024-11-7 10:32:20 评论举报李旗挺

答案对人有帮助，有参考价值 0 我将你的代码数据放到我们的EVM板上测试，发现你的PLL与Divider设置有问题。这个系数是你们需要的吗？并且没有power on divider。还有就是你们的配置时序也有点问题。建议参考如下顺序： page 0 is selected w 30 00 00 reg[ 0][ 1] = 0x01 ; Initialize the device through software reset 01 --------------------------------------------------------------- page 1 is selected w 30 00 01 reg[ 1][ 1] = 0x08 ; Disable weak AVDD to DVDD connection 08 reg[ 1][ 2] = 0x00 ; Enable Master Analog Power Control 00 reg[ 1][ 71] = 0x32 ; Set the input power-up time to 3.1ms w 30 47 32 reg[ 1][123] = 0x05 ; Force REF charging time to 40ms w 30 7b 05 --------------------------------------------------------------- page 0 is selected w 30 00 00 reg[ 0][ 5] = 0x91 ; P=1, R=1, J=24 w 30 05 91 reg[ 0][ 6] = 0x18 ; P=1, R=1, J=24 18 reg[ 0][ 7] = 0x00 ; D=0000 (MSB) 00 reg[ 0][ 8] = 0x00 ; D=0000 (LSB) 00 reg[ 0][ 4] = 0x03 ; PLL_clkin = MCLK, codec_clkin = PLL_CLK, PLL on w 30 04 03 reg[ 0][254] = 0x0a ; Delay 10ms for PLL to lock w 30 fe 0a reg[ 0][ 12] = 0x88 ; MDAC = 8, divider powered on w 30 0c 88 reg[ 0][ 13] = 0x03 ; DOSR = 768 (MSB) 03 reg[ 0][ 14] = 0x00 ; DOSR = 768 (LSB) 00 reg[ 0][ 18] = 0x02 ; NADC = 2, divider powered off w 30 12 02 reg[ 0][ 19] = 0xb0 ; MADC = 48, divider powered on b0 reg[ 0][ 20] = 0x80 ; AOSR = 128 80 reg[ 0][ 11] = 0x82 ; NDAC = 2, divider powered on w 30 0b 82

2024-11-7 10:33:55 评论举报夏日余晖

答案对人有帮助，有参考价值 0 根据您提供的信息，您在使用AIC3204时遇到了BCLK和WCLK输出的问题。您已经确认了硬件连接和I2C通信正常。以下是一些建议和可能的解决方案： 1. 检查AIC3204的配置寄存器设置：确保您已经正确配置了AIC3204的寄存器，以便在主模式下输出BCLK和WCLK。您可以参考AIC3204的数据手册，确保所有相关的寄存器设置正确。 2. 检查MCLK的频率：您提到使用了10MHz的有源晶振作为MCLK。请确保MCLK的频率符合AIC3204的要求。如果MCLK频率不正确，可能会导致BCLK和WCLK输出异常。 3. 检查BCLK和WCLK的输出引脚：请确保您已经正确连接了BCLK和WCLK的输出引脚。如果引脚连接错误，可能会导致输出信号无法正常输出。 4. 检查MCU的I2C时序：虽然您已经确认了I2C通信正常，但请再次检查MCU的I2C时序，确保时序符合AIC3204的要求。错误的时序可能会导致寄存器设置不正确，从而影响BCLK和WCLK的输出。 5. 检查AIC3204的电源：请确保AIC3204的电源电压和电流符合其规格要求。如果电源不稳定或不足，可能会导致AIC3204无法正常工作。 6. 检查AIC3204的固件：请确保您使用的AIC3204固件是最新的，并且与您的硬件配置兼容。过时或不兼容的固件可能会导致BCLK和WCLK输出异常。 7. 使用示波器检查BCLK和WCLK信号：如果可能的话，使用示波器检查BCLK和WCLK的输出信号。这可以帮助您确定问题是否出在AIC3204本身，还是由于其他原因导致的。希望以上建议能帮助您解决问题。如果问题仍然存在，请提供更多详细信息，以便我们能更好地帮助您。

2024-11-8 09:19:06 评论举报刘丰标

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