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我买了夏宇闻老师的《Verilog 数字系统设计教程》(第四版) 其中第114页有一个例子,我想做这个实验,可是不成功 代码为:
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2个回答
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无需VCS,modelsim就行。
参考这个链接的说明:
从个人角度来讲,通常FPGA仿真是不会这么无聊添加这些的。
最佳答案
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参考这个链接的说明:
从个人角度来讲,通常FPGA仿真是不会这么无聊添加这些的。 |
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