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//异或源文件 module xor2(x1,x2,z1); input x1,x2; output z1; wire x1,x2; wire z1; assign z1=x1^x2; endmodule //testbench文件 `timescale 1ns/100ps module xor2_tb; reg x1,x2; wire z1; initial begin #0 x1=0; x2=0; #10 x1=1; x2=0; #10 x1=0; x2=1; #10 x1=1; x2=1; #10 $stop; end /*出错段落 begin reg [2:0] i; for(i=0;i<4;i=i+1) begin {x1,x2}=i [2:0]; #10 $display("{x1x2} = %b,z1 = %b",{x1,x2},z1); end end */ xor2 test ( .x1(x1), .x2(x2), .z1(z1) ); endmodule /* 仿真结果 出错段落被注释仿真图:正常仿真结果 ![]() |
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